精材(3374)昨天召開法說會,公布去年第四季財報,稅後純益 8.31 億元,季增 38.9%,年增 324%,每股稅後純益 3.07 元,去年全年稅後純益 17.27 億元,年增 849%,每股稅後純益 6.37 元;受惠晶圓級封裝需求成長,加上新增測試業務稼動率滿載,去年第四季、全年獲利皆創新高。
精材去年受惠 3D 感測元件封裝淡季不淡,加上下半年客戶拉貨力道持強,晶圓級尺寸封裝業績較前年大幅成長,尤其新增的 12 吋晶圓測試業務,產能一開稼動率就滿載,推升整體營收、獲利改寫新猷。
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🕵️♀關於精材(3374):
精材(3374)為台灣晶圓級封裝廠,也是台積電(2330)與Omni Vision的共同轉投資公司。公司成立於1998年9月,主營晶圓級晶方尺寸封裝業務(Wafer Level Package CSP;WLCSP),於2007年,台積電策略性投資,成為精材最大的法人股東。成立之初,公司專注於CMOS光學感測器的晶圓級封裝市場,為配合台積電需求,增加微機電(MEMS)封測與LED封裝服務。 台積電持有精材股權超過3成。
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🏭主要產品:
晶圓級尺寸封裝(Wafer Level Chip Scale Packaging) 、晶圓級後護層封裝(Wafer Level Post Passivation Interconnection),主要應用於CMOS 影像感測元件、指紋辨識、微機電系統感測器(MEMS)、射頻IC,產品涵蓋消費電子、通訊、電腦、工業、汽車等五大領域。
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WLCSP封裝技術:與傳統封裝比較,WLCSP 提供較低成本、較小尺寸與導電散熱性能提升等優勢,適用於行動裝置相關IC,而精材主要供應CMOS 影像感測器(CIS)。不同於傳統封裝製程,在晶圓切割後才封裝個別晶粒,WLCSP 在晶圓層級上進行所有封裝製程。WLCSP 是一種晶片尺寸封裝技術,封裝後晶片尺寸與晶粒一致。此外WLCSP 以銲錫球狀凸塊將晶粒和印刷電路板互連,省去基板空間,因而尺寸能較其他封裝方式更小。
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WLPPI封裝技術:精材為台積電turnkey解決方案的合作廠商,也提供PMIC、MEMS感應器與指紋辨識感測器用WLPPI 解決方案,主要包括RDL 製程,通常於晶圓製造之後執行。在此之後,晶圓會被送至打線封裝廠商(日月光)。
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主要競爭對手:
影像感測器:晶方、華天科技
指紋辨識感測:晶方
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🔥[修正式價值投資]檢視五大評分內容:
不滿足股本<20億,被扣了4分
進10年自由現金流入,10年中有4年自由現金流入,獲得8分。
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其他
營收創新高能力、獲利來自本業、最近3個月營收比去年成長,皆獲得滿分,在修正式模組中獲得總得分為84分。
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1. 營收創新高能力:
近期月營收符合20個月新高以上的條件,所以此條件獲得0分。
(篩選近期營收創新高的企業,股價潛力越有上漲的潛力。)
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2. 獲利來自本業:
本業稅前淨利>90,所以此條件獲得滿分10分。
(本業獲利是重要指標,若企業獲利來源是業外收入,有可能為一次性收入,並非長期,得多加注意!)
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3. 股本小優先:
滿足股本<10億,獲得滿分10分。
(修正式價值投資認為股本小營收表現佳的企業,可判定為潛力股,股價容易被低估,可能是還沒被市場發掘的好公司。)
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4. 最近3個月營收比去年成長:
近3個月營收總額比去年成長>50%以上,獲得30分
(營收若比去年同期增長,表示正在擴大市場,值得投資人關注。)
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5. 自由現金流入:
近10年,其中4年有自由現金流入,被扣16分,獲得8分,現金流偏低(滿分為20分)。
檢視公司體質是否穩定,現金流穩定的公司,更有成長的本錢。
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# [陳啟祥]修正式價值投資
https://bit.ly/3j6Msjw
#在修正式模組中獲得84分
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首爾半導體宣稱最新無封裝晶圓級LED晶片,突破許多傳統CSP技術,對封裝產業有什麼衝擊?敬請期待LEDinside後續解析。
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#物聯網IoT #半導體製程 #扇出型封裝 #晶圓級封裝WLP #3D列印 #印刷電子 #覆晶FlipChip #底部填充膠underfill #表面黏著技術SMT #系統級封裝SiP #堆疊封裝PoP #晶片尺寸封裝CSP #奈米氣溶膠噴塗AerosolJet
【當物聯網元件的形式與材料不再「循規蹈矩」……】
有「積層製造」或「加法製造」(additive manufacturing) 別稱的 3D 列印,在半導體製程漸受矚目。3D 列印可降低光罩費用、甚至完全不需光罩便能直接成像,是製作先進奈米原型首選,將大幅簡化微型 LED 電路印刷、穿戴式感測器/天線製作、扇出/扇入型晶圓級封裝 (FOWLP / FIWLP) 重佈線 (RDL) 工作;預估至 2020 年,印刷電子 (Printed Electronics) 市場將達 120 億美元。
覆晶凸塊 (Flip Chip bump) 因可支援機械和電子連接,且互連短、電感 (Inductance) 低、電性表現良好備受關注。由於覆晶封裝的精細線徑、區域陣列 (Area Array) 和高密度的內部互連架構,通常需要中介載板 (interposer) 為較粗的板級組裝重佈線 I/O;為了讓封裝體積更趨薄型化,業界試圖透過 RDL 技術取代中介板,有 Fan-in 和 Fan-out 兩種途徑。
封裝對元件的整體效能影響至深、RDL 是晶圓級封裝的關鍵元素,而借助 3D 列印進行 RDL 兼具低成本和設計彈性,有助推動小量的晶片尺寸封裝 (CSP)。另「奈米氣溶膠噴塗」(Aerosol Jet) 技術可增加材料的可選性,廣泛用於導體、隔離器、電阻、生化材料和陶瓷元件製造,對於在立體基板上製作天線尤具優勢。
延伸閱讀:
《3D 列印+奈米氣溶膠噴塗+雷射燒結,軟性電路有解》
http://compotechasia.com/a/____//2017/1018/36976.html
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